Der Hintergrundband gibt dem Entwurfsspezialisten Gelegenheit, den großen Entwurf des RISC-Prozessors TOOBSIE an beliebiger Stelle "bis ins letzte Bit" zu untersuchen oder den Entwurf als Ganzes für eigene Experimente oder die Entwicklung eigener CAD-Werkzeuge zu übernehmen. Hierzu gehören neben einer detaillierten Dokumentation des Befehlssatzes und den vollständigen ablauffähigen VERILOG-Modellen auch die umfangreiche graphische Gatternetzliste. Gerade die vollständige Offenlegung aller Einzelheiten dürfte das Werk von anderen Büchern, aber auch von anderen großen kommerziellen Entwürfen unterscheiden.
Aktualisiert: 2023-07-02
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Der Hintergrundband gibt dem Entwurfsspezialisten Gelegenheit, den großen Entwurf des RISC-Prozessors TOOBSIE an beliebiger Stelle "bis ins letzte Bit" zu untersuchen oder den Entwurf als Ganzes für eigene Experimente oder die Entwicklung eigener CAD-Werkzeuge zu übernehmen. Hierzu gehören neben einer detaillierten Dokumentation des Befehlssatzes und den vollständigen ablauffähigen VERILOG-Modellen auch die umfangreiche graphische Gatternetzliste. Gerade die vollständige Offenlegung aller Einzelheiten dürfte das Werk von anderen Büchern, aber auch von anderen großen kommerziellen Entwürfen unterscheiden.
Aktualisiert: 2023-07-02
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Aktualisiert: 2023-01-22
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Dieses Lehr- und Arbeitsbuch führt in den modernen Entwurf großer Chips ein. Ein großer, leistungsfähiger RISC-Prozessor wird in einer Hardware-Beschreibungssprache (HDL) spezifiziert, hierarchisch entwickelt und schließlich als Gattermodell dem Halbleiterhersteller zur Fertigung übergeben. Das Ergebnis ist ein Semi-Custom-Prozessor mit über 100.000 Bruttogattern und einer Rechenleistung von bis zu 40 MIPS. Das Buch mit Diskette führt auch ausführlich in die HDL VERILOG ein.
Aktualisiert: 2022-03-09
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Der Hintergrundband gibt dem Entwurfsspezialisten Gelegenheit, den großen Entwurf des RISC-Prozessors TOOBSIE an beliebiger Stelle "bis ins letzte Bit" zu untersuchen oder den Entwurf als Ganzes für eigene Experimente oder die Entwicklung eigener CAD-Werkzeuge zu übernehmen. Hierzu gehören neben einer detaillierten Dokumentation des Befehlssatzes und den vollständigen ablauffähigen VERILOG-Modellen auch die umfangreiche graphische Gatternetzliste. Gerade die vollständige Offenlegung aller Einzelheiten dürfte das Werk von anderen Büchern, aber auch von anderen großen kommerziellen Entwürfen unterscheiden.
Aktualisiert: 2023-04-03
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Dieses Lehr- und Arbeitsbuch führt in den modernen Entwurf großer Chips ein. Ein großer, leistungsfähiger RISC-Prozessor wird in einer Hardware-Beschreibungssprache (HDL) spezifiziert, hierarchisch entwickelt und schließlich als Gattermodell dem Halbleiterhersteller zur Fertigung übergeben. Das Ergebnis ist ein Semi-Custom-Prozessor mit über 100.000 Bruttogattern und einer Rechenleistung von bis zu 40 MIPS. Das Buch mit Diskette führt auch ausführlich in die HDL VERILOG ein.
Aktualisiert: 2023-04-04
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Der Hintergrundband gibt dem Entwurfsspezialisten Gelegenheit, den großen Entwurf des RISC-Prozessors TOOBSIE an beliebiger Stelle "bis ins letzte Bit" zu untersuchen oder den Entwurf als Ganzes für eigene Experimente oder die Entwicklung eigener CAD-Werkzeuge zu übernehmen. Hierzu gehören neben einer detaillierten Dokumentation des Befehlssatzes und den vollständigen ablauffähigen VERILOG-Modellen auch die umfangreiche graphische Gatternetzliste. Gerade die vollständige Offenlegung aller Einzelheiten dürfte das Werk von anderen Büchern, aber auch von anderen großen kommerziellen Entwürfen unterscheiden.
Aktualisiert: 2023-04-04
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